This course can also be taken for academic credit as ECEA 5361, part of CU Boulder’s Master of Science in Electrical Engineering degree.
Este curso faz parte do Programa de cursos integrados FPGA Design for Embedded Systems
oferecido por
Programa de cursos integrados FPGA Design for Embedded SystemsUniversidade do Colorado em BoulderInformações sobre o curso
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Certificados compartilháveis
Tenha o certificado após a conclusão
100% on-line
Comece imediatamente e aprenda em seu próprio cronograma.
Prazos flexíveis
Redefinir os prazos de acordo com sua programação.
Nível intermediário
Aprox. 36 horas para completar
Inglês
Legendas: Francês, Português (Brasil), Russo, Inglês, Espanhol
Habilidades que você terá
Writing Code in VerilogSimulating FPGA DesignsDesigning FPGA LogicDesigning Test BenchesWriting code in VHDL
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Inglês
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Universidade do Colorado em Boulder
CU-Boulder is a dynamic community of scholars and learners on one of the most spectacular college campuses in the country. As one of 34 U.S. public institutions in the prestigious Association of American Universities (AAU), we have a proud tradition of academic excellence, with five Nobel laureates and more than 50 members of prestigious academic academies.
Comece a trabalhar rumo ao seu mestrado
This curso is part of the 100% online Master of Science in Electrical Engineering from Universidade do Colorado em Boulder.
If you are admitted to the full program, your courses count towards your degree learning.
Programa - O que você aprenderá com este curso
8 horas para concluir
Basics of VHDL
This module introduces the basics of the VHDL language for logic design. It describes the use of VHDL as a design entry method for logic design in FPGAs and ASICs. To provide context, it shows where VHDL is used in the FPGA design flow. Then a simple example, a 4-bit comparator, is used as a first phrase in the language. VHDL rules and syntax are explained, along with statements, identifiers and keywords. Finally, use of simulation as a means of testing VHDL circuit designs is demonstrated using ModelSim, a simulator software tool. Programming assignments are used to develop skills and reinforce the concepts presented.
8 horas para concluir
10 vídeos (Total 48 mín.), 2 leituras, 6 testes
10 videos
Why Learn VHDL?1min
FPGA Design Flow3min
Intro to VHDL: Finite State Machine3min
How to speak VHDL, first phrases6min
VHDL Assignments, Operators, Types3min
VHDL Rules and Syntax, Interface Ports3min
VHDL in ModelSim: Download and Install3min
VHDL in ModelSim: Adding to your Toolkit6min
Submitting VHDL Programming Assignments11min
2 leituras
Misson 2-001: Week 1 Readings2h
Files for Week 1 Programming Assignments10min
2 exercícios práticos
VHDL Find the Code Errors30min
Module 1 Quiz30min
12 horas para concluir
VHDL Logic Design Techniques
In this module use of the VHDL language to perform logic design is explored further. Many examples of combinatorial and synchronous logic circuits are presented and explained, including flip-flops, counters, registers, memories, tri-state buffers and finite state machines. Methods of hierarchical design and modular design techniques are explained and demonstrated. How to create test benches is described as a means for design verification. Students are giving ample opportunity to practice and refined their design technique using the programming assignments.
12 horas para concluir
10 vídeos (Total 52 mín.), 2 leituras, 6 testes
10 videos
Combinatorial Circuits4min
Synchronous Logic: Latches and Flip Flops4min
Synchronous Logic: Counters and Registers6min
Buses and Tristate Buffers3min
Modular Designs: Components, Generate and Loops in VHDL3min
Test Benches in VHDL: Combinatorial8min
Test Benches in VHDL: Synchronous5min
Memory in VHDL7min
Finite State Machines in VHDL8min
2 leituras
Week 2 Readings2h
Files for Week 2 Programming Assignments10min
1 exercício prático
Module 2 Quiz30min
7 horas para concluir
Basics of Verilog
This module introduces the basics of the Verilog language for logic design. It describes the use of Verilog as a design entry method for logic design in FPGAs and ASICs, including the history of Verilog's development. Then a simple example, a 4-bit comparator, is used as a first phrase in the language. Verilog rules and syntax are explained, along with statements, operators and keywords. Finally, use of simulation as a means of testing Verilog circuit designs is demonstrated using ModelSim, a simulator tool. Programming assignments are used to develop skills and reinforce the concepts presented.
7 horas para concluir
9 vídeos (Total 92 mín.), 2 leituras, 6 testes
9 videos
Your First Verilog phrase11min
Verilog Rules and Syntax; Keywords and Identifiers; Sigasi/Quartus editing12min
Verilog Statements and Operators16min
Verilog Modules, Port Modes and Data Types10min
Verilog Structure10min
Testing with ModelSim5min
Verilog Evaluation11min
Submitting Verilog Programming Assignments10min
2 leituras
Week 3 Readings1h 10min
Files for Week 3 Programming Assignments10min
2 exercícios práticos
Verilog Find the Errors20min
Module 3 Quiz30min
10 horas para concluir
Verilog and System Verilog Design Techniques
In this module use of the Verilog language to perform logic design is explored further. Many examples of combinatorial and synchronous logic circuits are presented and explained, including flip-flops, counters, registers, memories, tri-state buffers and finite state machines. Methods of hierarchical design and modular design techniques are explained and demonstrated. How to create test benches is described as a means for design verification. Students are giving ample opportunity to practice and refined their design technique by writing code as required by the programming assignments.
10 horas para concluir
10 vídeos (Total 48 mín.), 2 leituras, 6 testes
10 videos
Combinatorial Circuits5min
Synchronous Logic: Latches and Flip Flops3min
Synchronous Logic: Counters and Registers5min
Buses and Tristate Buffers3min
Modular Design in Verilog3min
Testbenches in Verilog7min
Testbenches in Verilog II2min
Memory with Verilog4min
Verilog Finite State Machines7min
2 leituras
Week 4 Readings15min
Files for Week 4 Programming Assignments10min
1 exercício prático
Module 4 Quiz30min
Avaliações
Principais avaliações do HARDWARE DESCRIPTION LANGUAGES FOR FPGA DESIGN
por MS15 de Mai de 2020
This course is very helpful in understanding the basics of hardware description languages and now after doing this course i am very much comfortable in using verilog and vhdl language.
por RL1 de Mai de 2020
The Verilog course was very good. However the vhdl course could have been better.Needed a bit more clarity on the assignments.The lectures could have used a bit more explanation.
por KK4 de Jun de 2020
This is very good course , but i found some little missing details related to reading materials . But this was really very helpful course for me as fresher .
por R30 de Jul de 2020
The course helped in showing the different styles of the Verilog and VHDL coding. Understood the advantages of Verilog and VHDL in real life applications
Sobre Programa de cursos integrados FPGA Design for Embedded Systems
The objective of this course is to acquire proficiency with Field Programmable Gate Arrays (FPGA)s for the purpose of creating prototypes or products for a variety of applications. Although FPGA design can be a complex topic, we will introduce it so that, with a little bit of effort, the basic concepts will be easily learned, while also providing a challenge for the more experienced designer. We will explore complexities, capabilities and trends of Field Programmable Gate Arrays (FPGA) and Complex Programmable Logic Devices (CPLD). Conception, design, implementation, and debugging skills will be practiced. We will learn specifics around embedded IP and processor cores, including tradeoffs between implementing versus acquiring IP. Projects will involve the latest software and FPGA development tools and hardware platforms to help develop a broad perspective of the capabilities of various Programmable SoC solutions. Topics include:
Perguntas Frequentes – FAQ
Quando terei acesso às palestras e às tarefas?
O acesso a palestras e tarefas depende do tipo de inscrição. Se você participar de um curso como ouvinte, você poderá ver quase todo o conteúdo do curso gratuitamente. Para acessar tarefas valendo nota e obter um Certificado, você precisará adquirir a experiência do Certificado, durante ou após a participação como ouvinte. Se você não vir a opção de participar como ouvinte:
- o curso pode não oferecer essa opção. Você pode experimentar um teste gratuito ou solicitar o auxílio financeiro.
- Em vez disso, o curso pode oferecer 'Curso completo, sem Certificado'. Com esta opção, é possível ver todo o conteúdo do curso, enviar as avaliações necessárias e obter uma nota final. Isso também significa que você não poderá comprar uma experiência de Certificado.
O que recebo ao me inscrever nesta Especialização?
Quando você se inscreve no curso, tem acesso a todos os cursos na Especialização e pode obter um certificado quando concluir o trabalho. Seu Certificado eletrônico será adicionado à sua página de Participações e você poderá imprimi-lo ou adicioná-lo ao seu perfil no LinkedIn. Se quiser apenas ler e assistir o conteúdo do curso, você poderá frequentá-lo como ouvinte sem custo.
Is financial aid available?
Sim, a Coursera oferece auxílio financeiro ao aluno que não possa pagar a taxa. Faça a solicitação clicando no link Auxílio Financeiro, abaixo do botão "Inscreva-se" à esquerda. Preencha uma solicitação e será notificado caso seja aprovado. Você terá que completar esta etapa para cada curso na Especialização, incluindo o Trabalho de Conclusão de Curso. Saiba mais .
Ganharei créditos universitários por concluir o curso?
Este curso não oferece créditos universitários, mas algumas universidades podem aceitar certificados de cursos que podem ser convertidos em créditos. Entre em contato com sua instituição para saber mais. Com os cursos on-line e os certificados Mastertrack™ do Coursera, é possível ganhar créditos universitários.
Mais dúvidas? Visite o Central de Ajuda ao Aprendiz.
